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af5cf0d1
编写于
11月 24, 2020
作者:
Y
Yinan Xu
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Regfile: use regfile_160x64_10w16r_sim for blackbox module name
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ff3c5b18
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并排
Showing
1 changed file
with
2 addition
and
2 deletion
+2
-2
src/main/scala/xiangshan/backend/regfile/Regfile.scala
src/main/scala/xiangshan/backend/regfile/Regfile.scala
+2
-2
未找到文件。
src/main/scala/xiangshan/backend/regfile/Regfile.scala
浏览文件 @
af5cf0d1
...
...
@@ -62,7 +62,7 @@ class Regfile
)
}
else
{
val
regfile
=
Module
(
new
RegfileBlackBox
)
val
regfile
=
Module
(
new
regfile_160x64_10w16r_sim
)
regfile
.
io
.
clk
:=
this
.
clock
regfile
.
io
.
gpr
:=
hasZero
.
B
...
...
@@ -143,7 +143,7 @@ class Regfile
}
class
RegfileBlackBox
extends
BlackBox
with
HasBlackBoxResource
{
class
regfile_160x64_10w16r_sim
extends
BlackBox
with
HasBlackBoxResource
{
val
io
=
IO
(
new
Bundle
{
val
clk
=
Input
(
Clock
())
...
...
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