- 02 7月, 2022 1 次提交
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由 张梓悦 提交于
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- 25 6月, 2022 1 次提交
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由 lixin 提交于
* Test the workflow of bus error unit when an ecc error occurs
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- 23 6月, 2022 2 次提交
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由 Guokai Chen 提交于
amtest,xsconfig: Support 256 external interrupt bits tests
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由 Xuan Hu 提交于
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- 19 6月, 2022 1 次提交
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由 wangkaifan 提交于
* Now the following four testcases can be covered: * Dma_master send write to cpu_dma, and hit the l3, so no transaction to real ddr * Dma_master send write to cpu_dma, and miss the l3, so there will i_soc.mem port write real ddr * Dma_master send read to cpu_dma, and hit the l3, so no transaction to real ddr * Dma_master send read to cpu_dma, and miss the l3, so there will i_soc.mem port read read ddr
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- 16 6月, 2022 1 次提交
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由 William Wang 提交于
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- 15 6月, 2022 2 次提交
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由 William Wang 提交于
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由 William Wang 提交于
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- 12 6月, 2022 1 次提交
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由 William Wang 提交于
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- 06 6月, 2022 3 次提交
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由 Guokai Chen 提交于
shrink PMEM size to reduce test setup time add sfence.vma before accessing any newly mapped virtual addresses
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由 lixin 提交于
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由 lixin 提交于
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- 05 6月, 2022 1 次提交
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由 lixin 提交于
* migrate from riscv-tests
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- 04 6月, 2022 1 次提交
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由 Guokai Chen 提交于
check RTC increments during a loop to make sure that RTC does not tick too fast
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- 15 5月, 2022 1 次提交
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由 William Wang 提交于
MMIO llcop takes time to take effect. Delay needs to be added before checking llcop result.
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- 14 5月, 2022 4 次提交
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由 William Wang 提交于
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由 William Wang 提交于
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由 William Wang 提交于
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由 William Wang 提交于
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- 12 5月, 2022 4 次提交
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由 Yinan Xu 提交于
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由 Yinan Xu 提交于
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由 Yinan Xu 提交于
Only 64 writes now.
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由 William Wang 提交于
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- 09 5月, 2022 1 次提交
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由 Yinan Xu 提交于
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- 07 5月, 2022 1 次提交
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由 wangkaifan 提交于
* note that --no-diff is require to do the test as INVALIDATE op will break coherence
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- 06 5月, 2022 2 次提交
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由 William Wang 提交于
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由 William Wang 提交于
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- 05 5月, 2022 2 次提交
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由 William Wang 提交于
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由 William Wang 提交于
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- 04 5月, 2022 8 次提交
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由 William Wang 提交于
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由 William Wang 提交于
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由 William Wang 提交于
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由 William Wang 提交于
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由 William Wang 提交于
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由 William Wang 提交于
Known problem: extintr test may stuck
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由 William Wang 提交于
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由 William Wang 提交于
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- 03 5月, 2022 2 次提交
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由 William Wang 提交于
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由 William Wang 提交于
CPUSS Peripheral, 0x1f_0000_0000, 0x1f_0fff_ffff Detailed address map: device, address_begin, address_end CLINT, 0x1f_0000_0000, 0x1f_0000_ffff BEU, 0x1f_0001_0000, 0x1f_0001_ffff Debug Module, 0x1f_0002_0000, 0x1f_0002_0fff MMPMA, 0x1f_0003_0000, 0x1f_0003_0fff L3CacheCtrl, 0x1f_0004_0000, 0x1f_0004_1fff reserved PLIC, 0x1f_0c00_0000, 0x1f_0fff_ffff Address map in tests to be updated
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- 02 5月, 2022 1 次提交
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由 William Wang 提交于
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