- 23 1月, 2021 2 次提交
- 22 1月, 2021 3 次提交
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由 William Wang 提交于
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由 William Wang 提交于
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由 William Wang 提交于
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- 21 1月, 2021 1 次提交
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由 William Wang 提交于
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- 20 1月, 2021 2 次提交
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由 William Wang 提交于
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由 William Wang 提交于
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- 19 1月, 2021 4 次提交
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由 William Wang 提交于
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由 William Wang 提交于
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由 William Wang 提交于
When sbuffer checks if it is empty, it needs to check if sq is also empty so there is no pending store. Errors will emerge rarely if we do not check sq.
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由 William Wang 提交于
* Gen selectMask in 2nd cycle, in parallel with DeqMask
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- 18 1月, 2021 2 次提交
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由 William Wang 提交于
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由 William Wang 提交于
We used to select writeback inst and update writebacked bit at the same cycle. However, it is too long to finish in one cycle. Now we select writeback inst and gen wbSelectedMask in cycle 1, then we use RegNext(wbSelectedMask) and writeback bit to select inst in the next cycle.
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- 15 1月, 2021 1 次提交
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由 Yinan Xu 提交于
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- 14 1月, 2021 2 次提交
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由 Yinan Xu 提交于
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由 wangkaifan 提交于
* values of hardware performance counters can hardly be emulated by NEMU
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- 13 1月, 2021 5 次提交
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由 William Wang 提交于
Now we have: * paddrModule * maskModule * exceptionModule * coredataModule (data & fwdmask)
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由 William Wang 提交于
This reverts commit 2e0406ca.
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由 William Wang 提交于
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由 William Wang 提交于
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由 William Wang 提交于
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- 12 1月, 2021 5 次提交
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由 William Wang 提交于
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由 William Wang 提交于
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由 William Wang 提交于
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由 William Wang 提交于
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由 Yinan Xu 提交于
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- 11 1月, 2021 4 次提交
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由 William Wang 提交于
* Stage 0 * Generate writeback indexes * Mark them as writebacked so they will not be selected the next cycle Stage 1 * Use indexes generated in cycle 0 to read data * Writeback data to cdb
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由 William Wang 提交于
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由 William Wang 提交于
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由 William Wang 提交于
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- 09 1月, 2021 1 次提交
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由 William Wang 提交于
Now storequeue dataModule is divided into 3 modules: * vaddrModule (2w1r) * exceptionModule (2w1r) * dataModule (core data module, 2w2r+fwd)
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- 08 1月, 2021 2 次提交
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由 Yinan Xu 提交于
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由 William Wang 提交于
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- 07 1月, 2021 1 次提交
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由 William Wang 提交于
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- 06 1月, 2021 1 次提交
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由 William Wang 提交于
Fp load uses different wb port from int load for 2 reasons: * Fp load needs recode, which is quite slow. We need one complete cycle for recoding. * Fp load data has nothing to do with int load data. There is no reason to mix them together. An extra recode stage (load_s3) is added for fp load, while int load will still be writebackd at load_s2.
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- 01 1月, 2021 1 次提交
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由 Yinan Xu 提交于
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- 26 12月, 2020 1 次提交
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由 Yinan Xu 提交于
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- 24 12月, 2020 1 次提交
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由 Yinan Xu 提交于
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- 23 12月, 2020 1 次提交
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由 Yinan Xu 提交于
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