- 13 7月, 2020 12 次提交
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由 jinyue110 提交于
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由 jinyue110 提交于
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由 jinyue110 提交于
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由 Lemover 提交于
BPU: add Tage's Perf Cnt && align the result
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由 ZhangZifei 提交于
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由 ljw 提交于
xiangshan,utils,LogUtils: optimize wires
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由 LinJiawei 提交于
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由 LinJiawei 提交于
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由 LinJiawei 提交于
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由 Zihao Yu 提交于
* Remove assert(), since they can be done at cpp files if needed * Calculate `(GTimer() >= disp_begin) && (GTimer() <= disp_end)` at the top level module only once, and wire such bool signal to where XSLog() is called. This can reduce the number of instances of counter created while GTimer() is callled. * Remove xsLogLevel. It seems meaningless, since we either need all logs for debugging, or no logs for running tests only. * With the above optimizion, running microbench with test input spends 120s on 9900k with log completely disabled (comment out the log code), but only spends 147s on 9900k with log enabled.
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由 GouLingrui 提交于
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由 GouLingrui 提交于
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- 12 7月, 2020 24 次提交
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由 GouLingrui 提交于
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由 ZhangZifei 提交于
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由 ZhangZifei 提交于
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由 jinyue110 提交于
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由 jinyue110 提交于
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由 jinyue110 提交于
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由 GouLingrui 提交于
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由 jinyue110 提交于
fix conflict in IFU/Ibuffer/XSCore
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由 zhanglinjuan 提交于
ibuffer: fix io.in.ready to "!full"
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由 jinyue110 提交于
Conflicts: src/main/scala/xiangshan/frontend/Ibuffer.scala Ibuffer: change in.ready exclude in.valid
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由 jinyue110 提交于
Conflicts: src/main/scala/xiangshan/XSCore.scala src/main/scala/xiangshan/frontend/Ibuffer.scala all Conflicts use incoming change
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由 jinyue110 提交于
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由 jinyue110 提交于
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由 ZhangZifei 提交于
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由 ljw 提交于
Adapt device address
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由 LinJiawei 提交于
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由 jinyue110 提交于
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由 zhanglinjuan 提交于
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由 ljw 提交于
IssueQueue: enable alu's bypass and all issueQueue recv bypass(may change it later)
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由 ZhangZifei 提交于
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由 jinyue110 提交于
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由 ZhangZifei 提交于
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由 ljw 提交于
dispatch2: allow configurations via exuConfig
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由 Yinan Xu 提交于
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- 11 7月, 2020 4 次提交
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由 William Wang 提交于
Difftest: update nemu version
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由 LinJiawei 提交于
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由 LinJiawei 提交于
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由 ZhangZifei 提交于
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