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785df9f0
编写于
6月 27, 2020
作者:
W
William Wang
提交者:
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6月 27, 2020
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Merge pull request #50 from RISCVERS/freelist-remove0
freelist: init freelist without preg0
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4e2453fb
822229c1
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并排
Showing
1 changed file
with
1 addition
and
1 deletion
+1
-1
src/main/scala/xiangshan/backend/rename/FreeList.scala
src/main/scala/xiangshan/backend/rename/FreeList.scala
+1
-1
未找到文件。
src/main/scala/xiangshan/backend/rename/FreeList.scala
浏览文件 @
785df9f0
...
...
@@ -19,7 +19,7 @@ class FreeList extends XSModule {
val
deallocPregs
=
Input
(
Vec
(
CommitWidth
,
UInt
(
PhyRegIdxWidth
.
W
)))
})
val
freeList
=
RegInit
(
VecInit
(
Seq
.
tabulate
(
NRPhyRegs
)(
i
=>
i
.
U
(
PhyRegIdxWidth
.
W
))))
val
freeList
=
RegInit
(
VecInit
(
Seq
.
tabulate
(
NRPhyRegs
-
1
)(
i
=>
(
i
+
1
)
.
U
(
PhyRegIdxWidth
.
W
))))
val
headPtr
=
RegInit
(
0.
U
((
PhyRegIdxWidth
+
1
).
W
))
val
tailPtr
=
RegInit
((
1
<<
PhyRegIdxWidth
).
U
((
PhyRegIdxWidth
+
1
).
W
))
...
...
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