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e1c76e77
编写于
1月 27, 2021
作者:
Z
ZhangZifei
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RS: fix bug of last cycle's fast hit and enq coflict
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99e133be
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Showing
1 changed file
with
3 addition
and
2 deletion
+3
-2
src/main/scala/xiangshan/backend/issue/ReservationStationNew.scala
...scala/xiangshan/backend/issue/ReservationStationNew.scala
+3
-2
未找到文件。
src/main/scala/xiangshan/backend/issue/ReservationStationNew.scala
浏览文件 @
e1c76e77
...
...
@@ -496,8 +496,9 @@ class ReservationStationData
val
fastHit
=
listenHit
(
fastUops
(
k
).
bits
,
srcSeq
(
j
),
srcTypeSeq
(
j
))
&&
fastUops
(
k
).
valid
val
fastHitNoConflict
=
fastHit
&&
!(
enqPtr
===
i
.
U
&&
enqEn
)
when
(
fastHitNoConflict
)
{
io
.
ctrl
.
srcUpdate
(
i
)(
j
)
:=
true
.
B
}
when
(
RegNext
(
fastHitNoConflict
))
{
data
(
j
).
listen
.
wen
(
i
)(
k
)
:=
true
.
B
}
XSDebug
(
fastHit
,
p
"FastHit: ${i.U} ${j.U} ${k.U} fastHit but enq conflict:${fastHit && (enqPtr===i.U && enqEn)}\n"
)
when
(
RegNext
(
fastHitNoConflict
)
&&
!(
enqPtr
===
i
.
U
&&
enqEn
))
{
data
(
j
).
listen
.
wen
(
i
)(
k
)
:=
true
.
B
}
XSDebug
(
fastHit
,
p
"FastHit: ${i.U} ${j.U} ${k.U}\n"
)
XSDebug
(
RegNext
(
fastHitNoConflict
)
&&
!(
enqPtr
===
i
.
U
&&
enqEn
),
p
"FastHit: but enq confict: ${i.U} ${j.U} ${k.U}\n"
)
}
for
(
k
<-
0
until
extraListenPortsCnt
)
{
val
slowHit
=
listenHit
(
slowPort
(
k
).
bits
.
uop
,
srcSeq
(
j
),
srcTypeSeq
(
j
))
&&
slowPort
(
k
).
valid
...
...
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