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XiangShan
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87c56180
编写于
1月 10, 2021
作者:
L
ljw
提交者:
GitHub
1月 10, 2021
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Merge pull request #390 from RISCVERS/fix-LoadUnit
LoadUnit: fixed FPload
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e55b653f
c3d4d93e
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内联
并排
Showing
1 changed file
with
1 addition
and
1 deletion
+1
-1
src/main/scala/xiangshan/mem/pipeline/LoadUnit.scala
src/main/scala/xiangshan/mem/pipeline/LoadUnit.scala
+1
-1
未找到文件。
src/main/scala/xiangshan/mem/pipeline/LoadUnit.scala
浏览文件 @
87c56180
...
...
@@ -293,7 +293,7 @@ class LoadUnit extends XSModule with HasLoadHelper {
io
.
fpout
.
bits
.
data
:=
fpRdataHelper
(
fpLoadOutReg
.
bits
.
uop
,
fpLoadOutReg
.
bits
.
data
)
// recode
io
.
fpout
.
valid
:=
RegNext
(
fpLoadOut
.
valid
&&
!
load_s2
.
io
.
out
.
bits
.
uop
.
roqIdx
.
needFlush
(
io
.
redirect
))
io
.
lsq
.
ldout
.
ready
:=
Mux
(
refillFpLoad
,
!
fpLoadOut
.
valid
,
!
intHitLoadOut
.
valid
)
io
.
lsq
.
ldout
.
ready
:=
Mux
(
refillFpLoad
,
!
fp
Hit
LoadOut
.
valid
,
!
intHitLoadOut
.
valid
)
when
(
io
.
ldout
.
fire
()){
XSDebug
(
"ldout %x\n"
,
io
.
ldout
.
bits
.
uop
.
cf
.
pc
)
...
...
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