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80653642
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8月 16, 2020
作者:
G
GouLingrui
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BIM, TAGE: reset valid bits when allocating a new entry
上级
fd77cc8c
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2
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内联
并排
Showing
2 changed file
with
5 addition
and
3 deletion
+5
-3
src/main/scala/xiangshan/frontend/Bim.scala
src/main/scala/xiangshan/frontend/Bim.scala
+4
-3
src/main/scala/xiangshan/frontend/Tage.scala
src/main/scala/xiangshan/frontend/Tage.scala
+1
-0
未找到文件。
src/main/scala/xiangshan/frontend/Bim.scala
浏览文件 @
80653642
...
...
@@ -12,7 +12,7 @@ trait BimParams extends HasXSParameter {
val
BimBanks
=
PredictWidth
val
BimSize
=
4096
val
nRows
=
BimSize
/
BimBanks
val
bypassEntries
=
16
val
bypassEntries
=
4
}
class
BIM
extends
BasePredictor
with
BimParams
{
...
...
@@ -104,9 +104,9 @@ class BIM extends BasePredictor with BimParams{
val
oldCtr
=
Mux
(
wrbypass_hit
&&
wrbypass_ctr_valids
(
wrbypass_hit_idx
)(
updateBank
),
wrbypass_ctrs
(
wrbypass_hit_idx
)(
updateBank
),
u
.
brInfo
.
bimCtr
)
val
newTaken
=
u
.
taken
val
newCtr
=
satUpdate
(
oldCtr
,
2
,
newTaken
)
val
oldSaturated
=
newCtr
===
oldCtr
//
val oldSaturated = newCtr === oldCtr
val
needToUpdate
=
io
.
update
.
valid
&&
!
oldSaturated
&&
u
.
pd
.
isBr
val
needToUpdate
=
io
.
update
.
valid
&&
u
.
pd
.
isBr
when
(
reset
.
asBool
)
{
wrbypass_ctr_valids
.
foreach
(
_
.
foreach
(
_
:=
false
.
B
))}
...
...
@@ -116,6 +116,7 @@ class BIM extends BasePredictor with BimParams{
wrbypass_ctr_valids
(
wrbypass_enq_idx
)(
updateBank
)
:=
true
.
B
}
.
otherwise
{
wrbypass_ctrs
(
wrbypass_hit_idx
)(
updateBank
)
:=
newCtr
(
0
until
BimBanks
).
foreach
(
b
=>
wrbypass_ctr_valids
(
wrbypass_enq_idx
)(
b
)
:=
false
.
B
)
// reset valid bits
wrbypass_ctr_valids
(
wrbypass_enq_idx
)(
updateBank
)
:=
true
.
B
wrbypass_rows
(
wrbypass_enq_idx
)
:=
updateRow
wrbypass_enq_idx
:=
(
wrbypass_enq_idx
+
1.
U
)(
log2Up
(
bypassEntries
)-
1
,
0
)
...
...
src/main/scala/xiangshan/frontend/Tage.scala
浏览文件 @
80653642
...
...
@@ -272,6 +272,7 @@ class TageTable(val nRows: Int, val histLen: Int, val tagLen: Int, val uBitPerio
wrbypass_ctr_valids
(
wrbypass_enq_idx
)(
updateBank
)
:=
true
.
B
}
.
otherwise
{
wrbypass_ctrs
(
wrbypass_enq_idx
)(
updateBank
)
:=
update_wdata
(
updateBank
).
ctr
(
0
until
TageBanks
).
foreach
(
b
=>
wrbypass_ctr_valids
(
wrbypass_enq_idx
)(
b
)
:=
false
.
B
)
// reset valid bits
wrbypass_ctr_valids
(
wrbypass_enq_idx
)(
updateBank
)
:=
true
.
B
wrbypass_tags
(
wrbypass_enq_idx
)
:=
update_tag
wrbypass_idxs
(
wrbypass_enq_idx
)
:=
update_idx
...
...
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