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1d2b32ad
编写于
1月 08, 2021
作者:
Y
Yinan Xu
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dispatchQueue: fix walkedTailPtr.flag generation logic
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136771cd
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1 changed file
with
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and
1 deletion
+1
-1
src/main/scala/xiangshan/backend/dispatch/DispatchQueue.scala
...main/scala/xiangshan/backend/dispatch/DispatchQueue.scala
+1
-1
未找到文件。
src/main/scala/xiangshan/backend/dispatch/DispatchQueue.scala
浏览文件 @
1d2b32ad
...
...
@@ -130,7 +130,7 @@ class DispatchQueue(size: Int, enqnum: Int, deqnum: Int) extends XSModule with H
val
validBitVec
=
VecInit
((
0
until
size
).
map
(
i
=>
stateEntries
(
i
)
===
s_valid
))
val
loValidBitVec
=
Cat
((
0
until
size
).
map
(
i
=>
validBitVec
(
i
)
&&
headPtrMask
(
i
)))
val
hiValidBitVec
=
Cat
((
0
until
size
).
map
(
i
=>
validBitVec
(
i
)
&&
~
headPtrMask
(
i
)))
val
flippedFlag
=
loValidBitVec
.
orR
val
flippedFlag
=
loValidBitVec
.
orR
||
validBitVec
(
size
-
1
)
val
lastOneIndex
=
size
.
U
-
PriorityEncoder
(
Mux
(
loValidBitVec
.
orR
,
loValidBitVec
,
hiValidBitVec
))
val
walkedTailPtr
=
Wire
(
new
CircularQueuePtr
(
size
))
walkedTailPtr
.
flag
:=
flippedFlag
^
headPtr
(
0
).
flag
...
...
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