提交 · 5e0d7666e9e4101215e0f2fbb0924e5bbebd50ca · OpenXiangShan / XiangShan

10 8月, 2020 10 次提交
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  Merge remote-tracking branch 'origin/dev-frontend' into dev-frontend-tage · 5e0d7666
  由 Lingrui98 提交于 8月 10, 2020
  
  5e0d7666
- predeocde:fix ret type · 36cbebc4
  由 Fa_wang 提交于 8月 10, 2020
  
  36cbebc4
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  Merge remote-tracking branch 'origin/master' into dev-frontend-tage · 3ebbd7b6
  由 Lingrui98 提交于 8月 10, 2020
  
  3ebbd7b6
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  Merge pull request #174 from RISCVERS/dev-frontend · 93a42f9c
  由 ljw 提交于 8月 10, 2020
```
memory out of bound fixed
```
  93a42f9c
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  Merge remote-tracking branch 'origin/dev-frontend' into dev-frontend-tage · 0a9a0d73
  由 Lingrui98 提交于 8月 10, 2020
  
  0a9a0d73
- L
  
  TAGE: uBitPeriod doubled · a2188c33
  由 Lingrui98 提交于 8月 10, 2020
  
  a2188c33
- predecode:fix ret type · 0711c1d2
  由 Fa_wang 提交于 8月 10, 2020
  
  0711c1d2
- Merge branch 'dev-frontend' of https://github.com/RISCVERS/XiangShan into dev-frontend · b2a603e1
  由 Fa_wang 提交于 8月 10, 2020
  
  b2a603e1
- predecode: fixed ret type(mbpright 63629->66373) · 12dcbb5b
  由 Fa_wang 提交于 8月 10, 2020
  
  12dcbb5b
- J
  
  uBTB: change update condition (same with BTB) · d19aa77c
  由 jinyue110 提交于 8月 10, 2020
  
  d19aa77c
07 8月, 2020 9 次提交
- L
  
  Merge remote-tracking branch 'origin/dev-frontend' into dev-frontend-tage · b023b44c
  由 Lingrui98 提交于 8月 07, 2020
  
  b023b44c
- L
  
  BPU: tage unconditianally overwrites, fix hist passing logic · 7cfef271
  由 Lingrui98 提交于 8月 07, 2020
  
  7cfef271
- G
  
  BPU: use outOfOrder updateInfo to update btb/ubtb/bim · 97feea0e
  由 GouLingrui 提交于 8月 07, 2020
  
  97feea0e
- J
  
  uBTB: fix target: use brtarget · ada418c1
  由 jinyue110 提交于 8月 07, 2020
  
  ada418c1
- G
  
  BPU: fix typos · 85dfb1ba
  由 GouLingrui 提交于 8月 07, 2020
  
  85dfb1ba
- G
  
  BPU: stage1 predvalid cannot be set true when in not valid · 2d8ff8ea
  由 GouLingrui 提交于 8月 07, 2020
  
  2d8ff8ea
- G
  
  BPU: Stage2 taken on indirects · 4f971039
  由 GouLingrui 提交于 8月 07, 2020
  
  4f971039
- J
  
  Merge branch 'dev-frontend' of https://github.com/RISCVERS/XiangShan into dev-frontend · ac999fd3
  由 jinyue110 提交于 8月 07, 2020
  
  ac999fd3
- J
  
  uBTB: add jalr surport and alloc_ways for banks · c49fa6f0
  由 jinyue110 提交于 8月 07, 2020
  
  c49fa6f0
06 8月, 2020 21 次提交
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  ifu: add c.j target-gen logic · c8cc6402
  由 zhanglinjuan 提交于 8月 06, 2020
```
predecode: fix bug in isCall and isRet

micorbench and coremark pass!
```
  c8cc6402
- Z
  
  Merge branch 'dev-frontend' into dev-rvc · ee50f29a
  由 zhanglinjuan 提交于 8月 06, 2020
  
  ee50f29a
- Z
  
  difftest: support skip mmio instr for RVCs · de27a4c3
  由 zhanglinjuan 提交于 8月 06, 2020
  
  de27a4c3
- L
  
  Merge remote-tracking branch 'origin/dev-frontend' into dev-frontend-tage · b048a8b0
  由 Lingrui98 提交于 8月 06, 2020
  
  b048a8b0
- L
  
  TAGE: read req masked · 5d87cd1f
  由 Lingrui98 提交于 8月 06, 2020
  
  5d87cd1f
- G
  
  BTB: update on jal not hits · 035fad39
  由 GouLingrui 提交于 8月 06, 2020
  
  035fad39
- Z
  
  ifu/bpu: fix bug in saveHalfRVI · e9199ec7
  由 zhanglinjuan 提交于 8月 06, 2020
  
  e9199ec7
- L
  
  Merge remote-tracking branch 'origin/dev-frontend' into dev-frontend-tage · 1ec7d80d
  由 Lingrui98 提交于 8月 06, 2020
  
  1ec7d80d
- G
  
  Merge branch 'dev-frontend' of https://github.com/RISCVERS/XiangShan into dev-frontend · b047ab77
  由 GouLingrui 提交于 8月 06, 2020
  
  b047ab77
- G
  
  BTB: fix idxbits in btbAddr · 2a384a62
  由 GouLingrui 提交于 8月 06, 2020
  
  2a384a62
- Z
  decoder: fix bug in src1Type for C_LUI · c9c84175
  由 zhanglinjuan 提交于 8月 06, 2020
```
predecode: fix bugs in mask output
```
  c9c84175
- Z
  fakeICache: fetch instructions 2-bytes aligned · 4ed69b39
  由 zhanglinjuan 提交于 8月 06, 2020
```
decoder: fix bug in immrvc

dummy passes!
```
  4ed69b39
- Y
  Merge pull request #173 from RISCVERS/opt-roq · a76dca9b
  由 Yinan Xu 提交于 8月 06, 2020
```
Optimize brq and roq; Add a firrtl transform
```
  a76dca9b
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  Merge remote-tracking branch 'origin/add-transforms' into opt-roq · 2ee98773
  由 linjiawei 提交于 8月 06, 2020
  
  2ee98773
- L
  
  debug: add a cputest script · 63163217
  由 linjiawei 提交于 8月 06, 2020
  
  63163217
- L
  
  Brq: use mem instead vec to reduce verilog code · c7130e0d
  由 linjiawei 提交于 8月 06, 2020
  
  c7130e0d
- Z
  
  Merge branch 'dev-frontend' of https://github.com/RISCVERS/XiangShan into dev-frontend · a1a4424b
  由 zhanglinjuan 提交于 8月 06, 2020
  
  a1a4424b
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  Opt roq · 6000bb34
  由 LinJiawei 提交于 8月 06, 2020
  
  6000bb34
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  BTB: update on correct predictions on jal · 98f9159d
  由 Lingrui98 提交于 8月 06, 2020
  
  98f9159d
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  Merge remote-tracking branch 'origin/dev-frontend' into dev-frontend-tage · 469848a4
  由 Lingrui98 提交于 8月 06, 2020
  
  469848a4
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  BTB: update on correct predictions on jal · 0c65e58b
  由 Lingrui98 提交于 8月 06, 2020
  
  0c65e58b

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